发射极耦合逻辑电路
发射极耦合逻辑是数字逻辑的一种非饱和形式(简称ECL),它可以消除影响速度特性的晶体管存储时间,因而能实现高速运行。发射极耦合是指电路内的差动放大器以发射极相连接,使差动放大器的输入阻抗高、电压增益大电路的输出部分为射极跟随器,以便恢复逻辑电平,降低输出阻抗,因而整个电路扇出容量大,驱动后续电路的能力强。当前在科学研究以及应用技术中要求数据获取的速度越来越快,数据的容量也越来越大,因而高速逻辑以及寄存单元都由发射极合逻辑构成。
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